图书介绍

高速实时数字信号处理器SHARC的原理及其应用【2025|PDF|Epub|mobi|kindle电子书版本百度云盘下载】

曾涛等编著著
出版社：北京：北京理工大学出版社
ISBN：7810456776
出版时间：2000
标注页数：183页
文件大小：11MB
文件页数：192页
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图书目录

第1章概述1

1.1 DSP的基本概念1

1.1.1 DSP的结构特点1

1.1.2 DSP的发展4

1.2 SHARC简介7

1.2.1 SHARC的基本结构7

1.2.2 SHARC指令的特点9

1.2.3 程序开发过程10

第2章 SHARC的基本结构与概念11

2.1 SHARC运算单元11

2.1.1 SHARC的数据格式11

2.1.2 算术逻辑单元(ALU)12

2.1.3 乘法器(MPU)13

2.1.5 数据寄存器15

2.1.4 移位器(SHIFTER)15

2.1.6 小结16

2.2 SHARC的程序流控制16

2.2.1 流水线机制16

2.2.2 指令Cache17

2.2.3 循环指令的程序流控制18

2.2.4 分支指令的程序流控制19

2.2.5 小结20

2.3 SHARC的中断20

2.3.1 SHARC中断的基本原理20

2.3.2 中断向量表及相关的控制寄存器20

2.3.3 SHARC中断使用23

2.3.4 中断现场保护24

2.3.5 中断重入25

2.3.6 小结25

2.4.1 地址空间26

2.4 地址空间和寻址26

2.4.2 寻址方式29

2.4.3 各种字长数据的传输32

2.4.4 小结34

第3章 DMA传输与串口、Link口通信35

3.1 DMA传输35

3.1.1 DMA的基本概念35

3.1.2 与DMA相关的寄存器36

3.1.3 外口DMA传输41

3.1.4 DMA中断42

3.1.5 DMA的优先级43

3.1.6 链式DMA43

3.1.7 小结47

3.2 串口通信47

3.2.1 SHARC串口简介47

3.2.2 重要寄存器及其使用49

3.2.3 串口中断54

3.2.4 串口DMA传输54

3.2.5 应用实例55

3.2.6 小结58

3.3 Link口58

3.3.1 Link口的构成58

3.3.2 Link口传输协议59

3.3.3 Link口的控制59

3.3.4 Link口缓存62

3.3.5 Link口DMA63

3.3.6 Link口中断64

3.3.7 DMA片内数据块搬移67

3.3.8 小结72

4.1.1 簇结构和基本形式73

4.1.2 总线仲裁73

第4章 SHARC系统设计73

4.1 SHARC的多处理器系统--簇结构73

4.1.3 多处理数据传递75

4.1.4 向量中断(VIRPT)76

4.1.5 相关的状态寄存器77

4.1.6 多SHARC互连77

4.1.7 小结77

4.2 MeshSP(网格)结构78

4.2.1 MeshSP(网格)结构的基本形式79

4.2.2 小结80

4.3 通过RTOS实现并行处理81

4.3.1 RTOS简介81

4.3.2 在RTOS环境下开发并行系统82

4.4 关键信号、JTAG接口与加载模式83

4.4.1 关键信号的定义与连接83

4.3.4 并行程序的开发与调试83

4.3.5 小结83

4.3.3 APEX PRO83

4.4.2 JTAG接口84

4.4.3 程序自加载86

4.4.4 小结89

4.5 高速数字电路设计简介89

4.5.1 非理想因素89

4.5.2 端挡匹配92

4.5.3 串扰性质及其消除94

4.5.4 传输延时一致性95

4.5.5 EDA设计95

4.5.6 SHARC系统设计中应注意的问题98

4.5.7 小结100

4.6 SHARC与FLASH MEMORY的接口100

5.1 SHARC指令系统的组成与分类106

第五章 SHARC的指令系统106

5.2 数学运算指令汇编110

5.2.1 ALU的数学运算指令110

5.2.2 MPU的数学运算指令123

5.2.3 Shifter的数学运算指令125

5.3 程序流控制指令后缀128

5.4 常用算法129

5.4.1 开平方129

5.4.2 除法130

5.4.3 正弦、余弦函数130

5.5 SHARC C语言132

5.5.1 SHARC C程序的开发过程132

5.5.2 混合编程135

5.5.3 语法扩展141

5.5.4 小结143

6.1 ADSP21061、ADSP21062、ADSP21065简介144

第6章 SHARC家族其他成员144

6.2 四SHARC的联合模块--AD14060145

6.2.1 AD14060的特点145

6.2.2 AD14060的内部结构145

6.3 高性能的SHARC二代--ADSP21160146

6.3.1 ADSP21160的特点146

6.3.2 单指令多数据流机制(SIMD)147

6.3.3 多样化的内存访问方式148

6.3.4 时钟149

6.4 SHARC家族的飞跃--TigerSHARC150

6.4.1 TigerSHARC的主要特点150

6.4.2 TigerSHARC的内核151

6.5 网上信息153

附录A 引脚功能描述与芯片封装形式154

附录B 时序160

附录C 寄存器168

参考文献183